[[FrontPage]] #contents 2009/05/01からのアクセス回数 &counter; 実際にプログラミングしてみると雑誌や本に書かれていないことがわかるものです。 今回は、 - VHDLのテストベンチは記述量が多く、使いにくい - 部品の結合は、VHDLでなく、回路図で行って、ツールを使ってVHDLに変換する のがよいことが分かりました。(とてもいい収穫でした) ** はじめに [#ncabc079] トランジスタ技術2006年4月付録のMAX IIと12月号から連載された「実験で学ぶロジック回路設計」 の教材だったHDL-CQ1を使ってCPLDのプログラミングをしてみます。 特集では、 - 回路図からの設計 - VHDLでの設計 の順で説明していますので、それにそって試してみます。 HDL-CQ1では、SELECTOR信号で7セグメントLEDを切り替えているため、 特集の第4章の例題は1個の7セグメントLEDを使うようにしました。 ** 開発環境 [#h8ec36ef] AlteraのQuartus II の最新のver.9.1は、Windows2000をサポートしていないので、開発環境ではVM Ware上にVer.7.1をインストールしました。 Ver.8.1より以前のQuartus IIではMacアドレスを送ってライセンスをAlteraから取得しますので、VM Ware のMacアドレスを固定にする必要があります。 VMイメージのvmxファイルをテキストエディタで開いて、以下の行を追加・変更します。 #pre{{ ethernet0.addressType = "static" ethernet0.address = "00:50:56:00:43:88" }} Macアドレスは、00:50:56までは固定で、残りは自由に設定してもよいそうです。 また、以下のツールもインストールしました。 - ModelSim-Altera 6.1g Web Edition - Veritak-Lite Ver. 2.05A7 (CQ版) ** 回路図の作成 [#u0045637] 回路図の書き方は、特集の記事にそってButtonCount_topを以下のように書きました。 &ref(top_layout.jpg); コネクタの配置は、 - MAX II付録ボードの配置は、&ref(BoardAndPinLayout.pdf); - HDL-CQ1の回路は、&ref(HDL-CQ1.pdf); を参照し、以下のようにピンの配置をしました。 &ref(pin_setting.jpg); 通常ですと、チャタリング除去のために、入力スイッチ回路にシュミット・トリガ・インバータIC を入れるのですが、Quartus IIではPCLD内部で処理することができます(ちょっと驚きました)。 同様にButtonCountを配置します。 回路の74160, 7447は、ロジックICの型番で、 - 74160はカウンタIC - 7447は、セグメントLED表示用IC で、 Quartus IIのライブラリに入っているものをそのまま使っています。 このように、既存のロジックICを組み合わせた回路なら、とても簡単にCPLDで代用することが できます。 &ref(ButtonCount_Layout1.jpg); ** シミュレーション [#x8420f68] WaveFormを使って、できあがった回路をシミュレーションします。 &ref(WaveForm1.jpg); 波形だけなので、セグメントLEDの表示がいまいち理解しづらいです。 ** 動作確認 [#ja02af85] Programmerで書き込んで、動作確認をします。 写真は、MANCLKのスイッチでカウントアップしている途中の様子です。 &ref(Counter.jpg); ** VHDLで書き替える [#ndd56d67] つぎに、ロジックICの回路をVHDLで記述し、 - 74160は、&ref(BCDCounter.vhd); - 7447は、&ref(Decode7Segment.vhd); としました。 *** VHDLで記述した部品を回路図で使えるようにする [#ld125d23] 作成した BCDCounter.vhd, Decode7Segment.vhdを回路図で使えるように シンボルを生成します。 - ProjectNavigatorでVHDLファイルを選択し - 右クリックでポップアップメニューを表示し、「Create SYmbol Fiels for Current File」を選択する &ref(CreateSymbol_Menu.jpg); ** 回路図からVHDLを作る [#caf2ec03] 先に作成したButtonCountの回路をBCDCounter.vhd、Decode7Segment.vhdを使って、 以下のように書き直します。 &ref(CounterVHDL_Layout.jpg); 次に、回路図を表示した状態でFile->Create/Update->Create HDL Design File for Current Fileメニュー を選択します。 &ref(CreateHDL_Menu.jpg); これでButtonCount.vhdが生成されました。どうようにBUttonCount_top.vhdも作成します。 - &ref(ButtonCount.vhd); - &ref(ButtonCount_top.vhd); ** Verilogとの相互変換 [#b620ae8c] これで、VHDLで記述した部品を組み合わせ、すべてのVHDLを作成することができました。 しかし、このままではQuartus IIを使わなくて、部品を作ったり、それをシミュレーションする ことができません。 そこで、フリーのVerilogシミュレーションを使うために、VHDLからVerilogに変換します。 *** Verilog-VHDL translator [#r70ab37a] フリーのVerilog-VHDL translatorが、 http://www002.upp.so-net.ne.jp/morioka/v2v.html に公開されています。 いろいろ探しましたが、VHDL→Verilogの変換ツールは少なく、フリーのソフトはこれのみでした。 また、VerilogからVHDLへの逆変換もサポートしており、ソースが公開されているのでとても便利です。 *** Verilogへの変換 [#kacb79f3] VHDLからVerilogへの変換はとても簡単です。 ターミナルから vhdl2verilog 変換するVHDLファイル名 を指定するだけです。 #pre{{ $ vhdl2verilog BCDCounter.vhd VHDL2Verilog ver1.00(2004/05/06) Copyright(c) S.Morioka (http://www02.so-net.ne.jp/~morioka/v2v.htm) Input file: BCDCounter.vhd Complete. $ }} ** コメント [#s330924c] この記事は、 #vote(おもしろかった,そうでもない,わかりずらい) 皆様のご意見、ご希望をお待ちしております。 #comment_kcaptcha